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操作系统论文:一种新型统一电能质量调节器UPQC硬件电路的设计
一种新型统一电能质量调节器UPQC硬件电路的设计
| 文章出自:论文无忧网 | 编辑:发表咨询 | 点击: | 2012-08-08 14:11:11 |

    摘要:统一电能质量调节器(UPQC)中关键部分是谐波电流等的检测及分离,由于其算法太复杂,因此系统实时性要求较高,一般如51和96系列微处理器由于速度远远达不到实时要求,针对此情况,本文设计了一种了基于DSP的UPQC系统部分硬件电路。

    电源芯片的选择LF2407A DSP的供电需要高质量的3.3V电源,且所需要的最大电流DI在正常工作模式下为120mA,本文选取的AMS 1117-3.3电源芯片,能够提供接近1A的电流,是低压差固定或可调电压输出调解器,固定输出3.3V,已经能够完全满足DSP系统的电源的需要。外部SRAM的选择本文在选取的赛普拉斯公司(C Y P R E S S)的C Y7C1021CV33-12ZXC芯片中,CY7C1021CV33-12ZXC是高速静态RAM,容量为1Mbit<(64K*16)的,存取时间为12ns,在不加等待周期的情况下完全可以满足LF2407A DSP在存取数据时对速度的要求;工作电流的最大值为85mA,供电电压3.3V,可通过DSP的供电芯片AMS1117进行供电;在不工作的时候,它还可以自动掉电,从而降低损耗;此外,ZXC代表了芯片的封装形式。

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